晚来的双并ES9018

我也爱DIY · 发表于 2013-11-18 19:07

好东西!傎得玩一玩

心只有你8958 · 发表于 2013-11-18 19:17

samuel-tong 发表于 2013-11-18 19:05
什么时候出成品啊。

有机会大家伙一起玩哈

心只有你8958 · 发表于 2013-11-18 20:08

上一张显示布局图显示非常好做也非常简单

发烧求败 · 发表于 2013-11-18 20:18

厉害不错

心只有你8958 · 发表于 2013-11-18 20:30

发烧求败发表于 2013-11-18 20:18
厉害不错

兄弟过奖了

井三 · 发表于 2013-11-18 20:41

提示: 作者被禁止或删除内容自动屏蔽

心只有你8958 · 发表于 2013-11-18 20:51

井三发表于 2013-11-18 20:41
漂亮！支持

感谢兄弟支持

暗黑狂龙 · 发表于 2013-11-18 20:53

KW 说元件排列太整齐.....

心只有你8958 · 发表于 2013-11-18 21:08

暗黑狂龙发表于 2013-11-18 20:53
KW 说元件排列太整齐.....

59401 · 发表于 2013-11-18 21:10

心只有你8958 发表于 2013-11-18 18:57
呵，你从哪里看的，官方文档吗？官方文档有这个说的吗？？？请你自己去用实机去测试一下，网上用过EP2的 ...

FPGA器件，对于抖动参数，文档上基本都有标的：
里边标的基本都是PJ之类的时域上的抖动参数。要对这个参数有相对的概念，可以看看大厂的普通有源晶振的PDF，里边应该都有标注PJ之类的参数，例如京瓷的产品。

发烧友1988 · 发表于 2013-11-18 21:13

灰常不错滴老兄出手不同凡响

心只有你8958 · 发表于 2013-11-18 21:30

发烧友1988 发表于 2013-11-18 21:13
灰常不错滴老兄出手不同凡响

现在在搞显示部分啦

心只有你8958 · 发表于 2013-11-18 21:30

59401 发表于 2013-11-18 21:10
FPGA器件，对于抖动参数，文档上基本都有标的：
里边标的基本都是PJ之类的时域上的抖动参数。要对这个参 ...

，难道你都是这样看一个芯片的吗？？，你看这个表只是给了一个最大值，能代表什么？在说了PLL内部有相位补尝，我的一个业内人室的朋友做过一个PLL的输出的的抖动测试，最最终得到的抖动在+-42ps左右（上下沿），这个数字是除掉，电源的干扰外，应该可以更小，不管你信不信，42ps对于100MHZ（10ns)你觉得大不大了！！，你可以自己进行测试，我在这里就不多说了，ES本身也是在100M以下的，在说了外部晶振，你觉得抖动小吗？？？，还是那句话，不管你信不信，PLL没有你想的那么垃圾，不然，你觉得ES内部也要用DLL（和PLL基本差别不大）,没有意义的讨论！！

long_3426 · 发表于 2013-11-18 21:32

心只有你8958 发表于 2013-11-18 00:54
先上一个OLED LOGO，让大家欣赏

这个是女人的手，

心只有你8958 · 发表于 2013-11-18 21:36

59401 发表于 2013-11-18 21:10
FPGA器件，对于抖动参数，文档上基本都有标的：
里边标的基本都是PJ之类的时域上的抖动参数。要对这个参 ...

我明白你这样业内从士，比较喜欢拿参数来比较，就好比，DAC输出一样，，，我很同意你们这样的做法，这样是对自己产品的一个负责的表现，不过不是所人的都能看得懂，，测试一个个稳定的DAC输出频率，我觉得意义不大，这个是个人一个另类的观点，一个DAC解码，最终还是由听感来决定！！

心只有你8958 · 发表于 2013-11-18 21:44

long_3426 发表于 2013-11-18 21:32
这个是女人的手，

纯正的带把的！！

59401 · 发表于 2013-11-18 21:59

心只有你8958 发表于 2013-11-18 21:30
，难道你都是这样看一个芯片的吗？？，你看这个表只是给了一个最大值，能代表什么？在说了PLL内部有相位 ...

一个正规厂的普通晶振，周期抖动都可以小于30PS（峰峰值）。这没啥，都是初级，你要把相位抖动（特别是低频噪声）做好，才叫牛。
单一方面来比较，FPGA里的PLL出来的时钟抖动参数，兴许还不如一个正规大厂的普通晶振来的好。
别说ESS的内部DPLL跟普通PLL差别不大，太玩笑，人家做出来的去抖动效果很好。

光拿参数说事，耳朵党不答应；光拿听感说事，那谈技术就是扯淡了。

心只有你8958 · 发表于 2013-11-18 22:06

59401 发表于 2013-11-18 21:59
一个正规厂的普通晶振，周期抖动都可以小于30PS（峰峰值）。这没啥，都是初级，你要把相位抖动（特别是低 ...

那你觉得每个人买一台解码回家都要做一个测试吗，然后出去说这个机子怎么怎么样？？？？机子好不好，不是光自己说对吧，得买的人说好才能算！！！还有PLL的抖动系数，对ES的主时钟来说是太小了，10ns的时钟，相对几十ps的抖动你觉得，有意义吗？？像ARM9 ，11 这个像高频CPU（500m以上)，内部的PLL估计抖动可是在100ps左右内的，如果觉得这样的抖动大，那你还想用吗？？，

59401 · 发表于 2013-11-18 22:14

心只有你8958 发表于 2013-11-18 22:06
那你觉得每个人买一台解码回家都要做一个测试吗，然后出去说这个机子怎么怎么样？？？？机子好不好，不是 ...

既然如此说，那还这样那样的追求低抖动时钟干嘛，不都是瞎整吗。

不让谈技术，你这帖子是干啥来哟，就为了显摆或是让人把你碰上天呐？

心只有你8958 · 发表于 2013-11-18 22:15

59401 发表于 2013-11-18 22:14
既然如此说，那还这样那样的追求低抖动时钟干嘛，不都是瞎整吗。
不让谈技术，你这帖子是干啥 ...

没说不让说技术对吧，你现在说的技术吗？

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