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 楼主| 发表于 2010-6-27 18:41 | 显示全部楼层
那做好了吗,关键是效果啊
yulishi 发表于 2010-6-27 13:54


layout已经基本完成了,修修改改,缝缝补补,搞了很久,关键电容的选型还没定下来。

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发表于 2010-6-28 11:52 | 显示全部楼层
157# 卖油翁

按你的理论,K170、K246、K373、K30等BL级的管子最佳静流是多少?

不是我的理论,前辈们早有研究,在同样结构的电路中同是BL档k170和k246的Rs是要求大不相同的,Borbely的文章《新境界》早有论述。还有k373和k30就自己去研究datasheet看看怎么偏置好。
阁下自己去看吧。还有Nelson Pass的文章《The Sweet Spot》(中译文:最佳听音位置)也有很多研究资料,这篇文章,把我们常说的听音的‘皇帝位’作为前言,形象地比喻晶体管的最佳工作点为‘皇帝位’,根据datasheet的指引,
再在失真分析仪的监测下找到具体晶体管的The Sweet Spot。
阁下要统统一视同仁也请便,就用你背熟的公式去套反正也不会放烟花。
我觉得阁下应该买一台失真分析仪,失真分析仪还可以包括互调失真的分析。
我们做机与西方人做机有一个显著的不同点:具体问题上套公式还是具体试验分析。
阁下做鹤顶红输入级也就套静态电流1~2mA的公式,
我上diyaudio.com,有网友在失真分析仪的监测下用高精度可调和固定电阻并联调节Rs获得其最适合的失真参数(那位网友喜欢3次谐波的比例稍大于2次谐波的比例)。
阁下如买了失真分析仪,做板卖是很有帮助的,对Borbely和Pass的论述也会有更深刻的认识。
那些名机为什么难仿制?因为是用实验的方式找出的针对那一批晶体管的最佳参数,换了批数那参数就要改的。
datasheet的参数是取典型值,仿真库就比datasheet又打了折扣例如BL档的就只有Idss=10mA的,所以仿真与datasheet只供参考,
实验阶段才是最为重要的,要不,Pass怎么会有他自己的实验室?Borbely也有自己的实验室。
我做F5也做了不少试验(虽然,我没有失真分析仪,只用手头有的简单工具)如Idss和Vp的测量,不同Idss的管子放在该电路的稳定性和听音试听等。
我觉得阁下应该把更大的劲头放在主动元件——晶体管上而不是主要精力放在被动元件——电阻电容上,我不否认补品元件的作用,但是忽略主动元件而过分强调被动元件我认为是主次颠倒,阁下对于线路的灵魂——晶体管不够重视(只套名机线路和背常规参数)把赌注押在电容上等到的会是什么结果?
我虽然不做板卖,我都正在物色廉价的失真分析仪。

这个可惜功能单一,测量不了THD

这个可惜功能单一,测量不了THD

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 楼主| 发表于 2010-6-28 12:11 | 显示全部楼层
目前在备料中,变压器已经到货了,找到一家给老美代工的厂订做的,那里只有225W的,次级4个45V的绕组,0.8mm的铜线绕制,初步测试一下,
空载输出电压46.8*2,
带1A负载,输出电压45.4*2
带2A负载,输出电压43.4*2
目前牛没有叫没有振.

niu.jpg

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发表于 2010-6-28 14:51 | 显示全部楼层
这是John Curl 最近在diyaudio.com的发言。

It should be understood that the JC-2 design is a PROVEN design topology that has been made in various versions for over 36 years. Slight deviations such as input fet types, output transistors or load resistors changes the distortion slightly, but not significantly. It is better just to build with the essential concepts intact. These are: Comp fet input, low value of load resistor, and fairly high current in the output transistors, 10ma min, 40-60 ma optimum. This will get you there.
__________________
"Condemnation without Examination is Prejudice"

John Curl  25th June 2010, 05:22 PM


这应该明白JC-2已经经过考验的布局,它被制作不同的版本超过36年。轻微的不同例如输入JFET的型号,输出晶体管或负载电阻的变化产生失真的轻度改变。制作它的较好的方法是有一个完整的基本观念,就是:配对的JFET输入,低值的负载电阻,和在输出晶体管足够高的电流,10ma最少,40~60ma最好。这将使你达到目的。

—————————————
没有分析研究的指责是偏见

John Curl   2010/06/25   05:22  PM

我们仿制名机,就要先掌握该名机的完整的基本观念

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 楼主| 发表于 2010-6-28 18:01 | 显示全部楼层
157# 卖油翁


不是我的理论,前辈们早有研究,在同样结构的电路中同是BL档k170和k246的Rs是要求大不相同的,Borbely的文章《新境界》早有论述。还有k373和k30就自己去研究datasheet看看怎么偏置好。
阁下自己 ...
ch639827608 发表于 2010-6-28 11:52


失真仪,俺们普通的diy哪能奢望这个啊!

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 楼主| 发表于 2010-6-28 18:34 | 显示全部楼层
157# 卖油翁


不是我的理论,前辈们早有研究,在同样结构的电路中同是BL档k170和k246的Rs是要求大不相同的,Borbely的文章《新境界》早有论述。还有k373和k30就自己去研究datasheet看看怎么偏置好。
阁下自己 ...
ch639827608 发表于 2010-6-28 11:52


赞同你的观点-晶体管是放大器的灵魂.

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发表于 2010-6-28 19:09 | 显示全部楼层
感觉思路不错啊。。。

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发表于 2010-6-28 21:00 | 显示全部楼层
157# 卖油翁


不是我的理论,前辈们早有研究,在同样结构的电路中同是BL档k170和k246的Rs是要求大不相同的,Borbely的文章《新境界》早有论述。还有k373和k30就自己去研究datasheet看看怎么偏置好。
阁下自己 ...
ch639827608 发表于 2010-6-28 11:52


高文29差分输入场管每管静态1.05mA,贝塔22每管1.1mA,MARK记29每管1.9mA,我再找找其他一些名机线路,基本没有PASS这个变态佬输入静流用10多mA的!

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发表于 2010-6-28 21:25 | 显示全部楼层
AUDIOLAB8000的输入级场管每管在正负12V下才2.4mA

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发表于 2010-6-28 21:55 | 显示全部楼层
168# 卖油翁

高文29差分输入场管每管静态1.05mA,贝塔22每管1.1mA,MARK记29每管1.9mA,我再找找其他一些名机线路,基本没有PASS这个变态佬输入静流用10多mA的!


John Curl 的JC-2输入级静态电流16mA!他曾经是Mark的有名设计师!
不是说1.1mA就不好,要看什么管,如果其Idss=2.6mA,Vp又不是特别低,那是可以的,但如果是Idss=10mA的k170运用在1.1mA的静态电流下就很接近夹断电压区了!
再说还有Idss=1mA的管子!你测量过高文那场管的Idss,Vp吗?你知道其跨导曲线特征吗?难道高文会跟你一样不问青红皂白就使其静流为1.05mA吗?
我没说任何低静态电流都不好,
问题的关键是根据该管子的跨导曲线来设计其工作点,不要盲目背“输入级静态电流1~2mA”的教条,你死背了这教条,就理解不了Pass和John Curl用这么大的静态电流了。
要知道所有名机都是根据管子的特性来设计工作点的,静流是工作点的参数之一,你却无条件死记一个参数代表管子的工作点!
DSC00496 d.jpg
DSC00497 d.jpg

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发表于 2010-6-29 10:58 | 显示全部楼层
169# 卖油翁

有些JFET的Idss 小于1ma。

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 楼主| 发表于 2010-6-29 23:33 | 显示全部楼层
今天一天,亏了3台前级,奶奶的。

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 楼主| 发表于 2010-6-30 00:25 | 显示全部楼层
明天要去九塞沟旅游,抓紧时间上进度(缓冲级电流暂定为5mA,RS约等于33欧),等管子到了再实际测试。
一体化布板,左右声道分别供电,电位器用加长杆,目前只layout了一个声道,等元件配齐之后确定无误,再copy另一个声道。
PCB-3.JPG
PCB-4.JPG

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 楼主| 发表于 2010-6-30 00:25 | 显示全部楼层
继续
PCB-5.JPG
PCB-6.JPG

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 楼主| 发表于 2010-6-30 00:27 | 显示全部楼层
铺地旁边的线是为了铺出一个有曲线的地用的,最终要删掉的。

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发表于 2010-6-30 07:22 | 显示全部楼层
支持楼主,何时下手啊?

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 楼主| 发表于 2010-6-30 07:57 | 显示全部楼层
支持楼主,何时下手啊?
0616sjxslb 发表于 2010-6-30 07:22


等主要材料准备得七七八八之后就做PCB。因为工作太忙,进展实在缓慢

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发表于 2010-7-1 01:42 | 显示全部楼层
集成运放的失真够小了吧,虽然比你的大,但是那是经过实践检验的,能仿真出来的未必能做的出来,一个4558的制造工艺都是你所不具有的!何必呢,0.1%的失真就够用了!

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发表于 2010-7-1 08:50 | 显示全部楼层
PCB正方形不利于抑制谐震啊

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