[DAC] 准备玩时钟IC CDCE9XX

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发表于 2011-6-12 21:02 | 显示全部楼层
啥????
wm8805不是说很低的抖动吗?
chenxiuping15 发表于 2011-6-12 20:35



在一般以上情况下,这话是没错的...

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发表于 2011-6-12 21:07 | 显示全部楼层
回复 21# 卡西利亚斯


    在什么时候是错的呢?

    一直在玩cs芯片,,看来,cs的功力很深啊

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发表于 2011-6-12 21:21 | 显示全部楼层
极地条件下.........

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 楼主| 发表于 2011-6-12 23:03 | 显示全部楼层
cdce913-1.jpg
用CDCE913也是看见TI推荐这样做,才敢动手,不可以想当然。
用CDCE913内部的VCXO控制远比一般压控晶振方便,而且性价比超高。
有兴趣的朋友可以去TI网找scaa088文件。
英文介绍如下:
For many audio applications a sampling clock or word clock of 44.1 kHz or 48.0 kHz is available through a
distribution network. The audio data converters in such applications are often Delta-Sigma,
modulator-based devices that can over-sample the signal by a factor of up to 512, resulting in a system
clock of 22.5792 MHz or 24.5760 MHz. This system clock must be synchronized with the low-frequency
sampling clock using a phase-locked loop (PLL), but the sampling clock is often too low in frequency for
use with many PLL-based clock drivers. Some audio PLLs can accept the low frequency sampling clock,
but create so much jitter on the system clock, that performance degrades.
The CDCE913 is a PLL-based clock driver with a VCXO input. It can drive a fundamental mode crystal in
the range of 8 to 32 MHz or receive a 1.8 V LVCMOS clock ranging from 8 to 160 MHz. Like most PLLs, if
the PLL internal to the CDCE913 is used to generate the system clock, it generates too much long-term
jitter; even though it has an excellent short-term period jitter performance of typically 60 ps peak-to-peak.
If we use its VCXO capabilities for synchronization and create a very low-loop bandwidth PLL, using an
external phase comparator (CD74HC4046A) and loop filter; a complete PLL is formed with excellent
long-term jitter performance and jitter-cleaning properties.

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 楼主| 发表于 2011-6-12 23:30 | 显示全部楼层
第3个应用是针对JITTER派准备做的工作。
DIR9001只能支持96K,而CS8416可以支持192。
好,那就利用CS8416接收192K,再利用CDCE913独立产生主时钟,数据派可以得到这样的理论结果:CS8416的产生的抖动达200PS主时钟,不用,可以通过CDCE913产生最小50PS jitter主时钟(还没彻底想通到底是否行)。

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 楼主| 发表于 2011-6-12 23:36 | 显示全部楼层
10年前的VCXO电路,找个VCXO晶振难死。
pll.jpg
现在可以利用IC集成技术得到这样的电路,简单!实用!
PLL2.JPG

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 楼主| 发表于 2011-6-12 23:42 | 显示全部楼层
本帖最后由 定音鼓 于 2011-6-12 23:43 编辑

第二个是为了CDPRO做的试验

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 楼主| 发表于 2011-6-13 00:02 | 显示全部楼层
第1个试验调试过程板,很不幸,最近搬家被收垃圾的拿走,不知道是否预示这个东西就是垃圾,哈
IMG_8829.jpg

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发表于 2011-6-13 00:05 | 显示全部楼层
第1个试验调试过程板,很不幸,最近搬家被收垃圾的拿走,不知道是否预示这个东西就是垃圾,哈
定音鼓 发表于 2011-6-13 00:02



  老兄越玩越高档了,口水

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 楼主| 发表于 2011-6-13 00:29 | 显示全部楼层
老兄越玩越高档了,口水
皋城瑶珄 发表于 2011-6-13 00:05

人都喜欢听好听的话,谢谢鼓励,再显摆下第2个试验应用板
IMG_8799-1.JPG

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发表于 2011-6-13 00:40 | 显示全部楼层
老肖30#的RCA插座是铁壳的吗?

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发表于 2011-6-13 00:45 | 显示全部楼层
第1个试验调试过程板,很不幸,最近搬家被收垃圾的拿走,不知道是否预示这个东西就是垃圾,哈
定音鼓 发表于 2011-6-13 00:02



    这布局布线,一看就知道是高级工程师的水准了

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发表于 2011-6-13 01:04 | 显示全部楼层
第1个试验调试过程板,很不幸,最近搬家被收垃圾的拿走,不知道是否预示这个东西就是垃圾,哈
定音鼓 发表于 2011-6-13 00:02


下次家里面要搞卫生的时候,记得通知我过来帮忙

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发表于 2011-6-13 12:49 | 显示全部楼层
10年前的VCXO电路,找个VCXO晶振难死。

现在可以利用IC集成技术得到这样的电路,简单!实用!
定音鼓 发表于 2011-6-12 23:36


U4 在这里是干嘛的?

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发表于 2011-6-13 23:03 | 显示全部楼层
下次家里面要搞卫生的时候,记得通知我过来帮忙
heyj 发表于 2011-6-13 01:04



    我也去!带上个超级大袋子收“垃圾”

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 楼主| 发表于 2011-6-14 03:16 | 显示全部楼层
老肖30#的RCA插座是铁壳的吗?
xmlhifi 发表于 2011-6-13 00:40

铁哪里能用啊,当然是铜,浙江货,09年2.5,现在3.5。其他说得过去,但中心用的塑料材料差。

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 楼主| 发表于 2011-10-30 14:47 | 显示全部楼层
2011年最终确定两种应用
1.时钟变换:用CDCD913是为了升频方便,轻松进行88.2、96、176.4和192各种升频。
IMG_9952.jpg
2.外接字时钟:将44.1K字时钟转换为转盘需要的主时钟,与外部解码器或者时钟进行同步。
IMG_9962-2.JPG

PS,CS8422是个好东西,之前是用AD1896A加CS8416加两片74系列,现在用一个CS8422搞掂。
下面之前的走弯路试验板。功能其实都一样,只是电路复杂了。
IMG_9934.jpg

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发表于 2011-10-30 22:43 | 显示全部楼层
回复 37# 定音鼓

板上带不带D/A解码?

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发表于 2011-10-31 13:14 | 显示全部楼层
只有肖兄的产品上能看到专业两个字的痕迹

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发表于 2011-10-31 14:38 | 显示全部楼层
板子很漂亮。
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