[DAC] 开始做参数最高的PCM1794

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发表于 2021-10-12 02:07 | 显示全部楼层

怎么我在PCM1794的PDF文档中找不到这一段文字

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 楼主| 发表于 2021-10-12 07:19 来自手机端 | 显示全部楼层
发烧求败 发表于 2021-10-12 02:07
怎么我在PCM1794的PDF文档中找不到这一段文字

是ti的另一个文档,第六页我放的有链接

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发表于 2021-10-12 12:06 | 显示全部楼层
我已经下定决心了 使用低噪声电压基准加扩流  噪声水平有望追平LT3046

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发表于 2021-10-13 06:51 来自手机端 | 显示全部楼层
准备用这个电路对PCM1794供电 有外国人测试过 这个国产的2DW232其噪声不大于0.5UVRMS 再用OPA1622扩流
理论上应该能实现较低的噪声
IMG_20211012_174046_edit_238714734658887.jpg

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 楼主| 发表于 2021-10-13 07:18 来自手机端 | 显示全部楼层
发烧求败 发表于 2021-10-13 06:51
准备用这个电路对PCM1794供电 有外国人测试过 这个国产的2DW232其噪声不大于0.5UVRMS 再用OPA1622扩流
理 ...

恩,理论上可以,只是验证性能有难度

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发表于 2021-10-13 08:36 来自手机端 | 显示全部楼层
其实性能变态的LT3045也是类似的工作原理 一个0.1ma的恒流源流过一个电阻 电阻两端的压降就是需要输出时电压 然后扩流输出
我认为实现低噪声的基础就是一个低噪声的电压基准
IMG_20211012_165846_edit_236940742777908.jpg

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 楼主| 发表于 2021-10-13 11:36 来自手机端 | 显示全部楼层
发烧求败 发表于 2021-10-13 08:36
其实性能变态的LT3045也是类似的工作原理 一个0.1ma的恒流源流过一个电阻 电阻两端的压降就是需要输出时电 ...

是这个理,但是自搭电路元件的精度和芯片比有些差距,无源元件注意选低温漂高精度器件,而且布线的信号环路更要注意控制

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发表于 2021-10-13 13:29 | 显示全部楼层
本帖最后由 czcboto 于 2021-10-13 13:32 编辑
发烧求败 发表于 2021-10-13 08:36
其实性能变态的LT3045也是类似的工作原理 一个0.1ma的恒流源流过一个电阻 电阻两端的压降就是需要输出时电 ...


仿3045关键就要用恒流源作为基准。
低噪声恒流源实现起来比低噪声电压源更容易,只要在Rset上并联一个低ESR电容就能同时降低恒流源的电流噪声、Rset的热噪声和运放的输入电流噪声,而要降低电压基准所产生的电压噪声需要一个复杂而且占用面积巨大的外部滤波电路。
JFET或者恒流二极管温飘太大了,没法用,推荐用LM134/234/334。
运放用AD797,低噪声高带宽,设计合理的话全面干翻3045轻而易举。
如果用分立件,有个神管THAT300S/THAT320S,并联着用可以实现非常恐怖的低噪声性能。

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 楼主| 发表于 2021-10-22 00:41 | 显示全部楼层
本帖最后由 592657820 于 2021-10-22 01:22 编辑

俄罗斯工程师开发的adc测试仪到了,测了一下参数

底噪-122db,算不错的数据,动态与理论差了10db,这个adc的动态范围在126db左右,应该不是adc量程限制,看来要实现132db的动态难度不小

频响曲线两线基本完全重合,但是20k后衰减斜率有点小,大概到90k完全衰减,官方是这样设计的

整机参数基本正常,模拟部分lpf还可以再尝试优化一下,下一步可以玩那个opa1612的线路了,失真应该比现在5534+1028的组合更低

11.JPG

2574.JPG

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 楼主| 发表于 2021-10-22 00:57 | 显示全部楼层
本帖最后由 592657820 于 2021-10-22 01:12 编辑
new1510 发表于 2021-9-26 23:40
DIY解码能做到这个底噪就差不多了,当然,有很多美弟阴弟的解码底噪也是很烂的,别迷信。


我的底噪曲线没有你的那么直,有几个峰还不清楚哪里的原因,看频率集中在100hz-3k之间,大概是因为pcb面积原因省去了一些大容量退藕电容造成的,这几个峰如果消掉了,整机信噪比也许能到-130db

附件上传了RMAA的完整报告

8541.JPG

11.JPG

pcm1794.zip

1.59 KB, 下载次数: 176

rmaa测试报告

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 楼主| 发表于 2021-10-22 01:30 | 显示全部楼层
顺便和朋友磨机换了三个ada4625-2的乂度xd05bal做一个参数对比,底噪与动态都不如我这个1794 ,算法原因rmaa和其他测量软件测出来的失真thd和thd+n都不太准,所以暂不做参考,各位看众也不要当真

微信图片_20211022012536.png

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发表于 2021-10-22 08:55 | 显示全部楼层
592657820 发表于 2021-10-22 01:30
顺便和朋友磨机换了三个ada4625-2的乂度xd05bal做一个参数对比,底噪与动态都不如我这个1794 ,算法原 ...

SNR和动态都不错,THD还有提升的空间,24/96这种测量环境,应该可以达到0.0007%

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592657820 发表于 2021-9-20 19:05
过程比较坎坷,先是pcb一个bug,有一处铺铜没有分配网络,直接导致几个电容没有互相链接,刮掉焊油堆锡解决 ...

好久没来,哈哈,理论不错,手工能力还是差点啊,元件建议去立创商城或者云汉芯城去买,不要去淘宝那些地方,正规开发不用来源不明的元件是基本要求。

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发表于 2021-10-22 15:46 | 显示全部楼层
cqxl 发表于 2021-10-22 08:55
SNR和动态都不错,THD还有提升的空间,24/96这种测量环境,应该可以达到0.0007%

上面说的不严谨。
这些个Δ∑芯片,16bit 44.1khz条件下,THD就会干到0.0007%;虽然16bit理论最低失真才0.0015%

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 楼主| 发表于 2021-10-22 21:26 | 显示全部楼层
本帖最后由 592657820 于 2021-10-22 21:35 编辑
cqxl 发表于 2021-10-22 15:46
上面说的不严谨。
这些个Δ∑芯片,16bit 44.1khz条件下,THD就会干到0.0007%;虽然16bit理论最低失真才 ...


试着测了一下,在16bit 44.1模式下,thd没有明显变化,imd反而还高了点,估计瓶颈在运放上面,但是信噪比和动态却下降了不少,看来现代Δ∑芯片在低码率时的参数并不是特别好,他们标称的参数全都是在高码率下测出的,有些老片子在16bit 44.1码率下或许会比现代芯片性能要好,这个说法听版主提到过,看来是真的,玩现代解码的话必须要配合src升频到高码率才能得到最佳效果,毛毛虫的拆机解码板就是一个例子(ad1896升频给ad1853),这个架构效果还是能打败不少老片子的

QQ截图20211022212230.jpg

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THD差了点

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592657820 发表于 2021-10-22 21:26
试着测了一下,在16bit 44.1模式下,thd没有明显变化,imd反而还高了点,估计瓶颈在运放上面,但是信噪 ...


不是的
从我测试过的早期Δ∑芯片比如CS4392/AK4396这样的,14 44.1下面,THD都是0.0007%这么变态的数值

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592657820 发表于 2021-10-22 00:57
我的底噪曲线没有你的那么直,有几个峰还不清楚哪里的原因,看频率集中在100hz-3k之间,大概是因为pcb ...

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本帖最后由 hds2019 于 2021-10-23 15:32 编辑

今天有空也搞个RMAA6试试,双PCM1794
PCM1794.jpg

底噪
noise.png

测试结果
[MME]PCM1794 44_1k 24bit 2.zip (39.92 KB, 下载次数: 155)

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hds2019 发表于 2021-10-23 15:28
今天有空也搞个RMAA6试试,双PCM1794

你的44.1测试时底噪和动态没变化,能看下实物和线路么?
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