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本帖最后由 jacksl528 于 2024-5-31 17:58 编辑
因为上次制作TDA1305T最终采用了差分输出方式, 借此机会,也学习了利用CPLD 、 FPGA的方式来撕裂I2S data信号 剥离出双声道data数据。
也实践验证过了, 我个人并不推荐使用该类方法, 准确的说,如果你对时钟信号的处理不是很在行, 并且目的只是为了 分离左右声道数据, 采用可编程逻辑电路 并不是一个完美的方案,
即使采用微型化的PAL之类的器件,也会产生巨大的开关噪声并消耗大量电流. 新型的FPGA器件可能会有所改进,但是它的噪声系数,与分立逻辑电路相比,仍然不是一个数量级。
我也查到有类似专门针对低噪声、低功耗的FPGA芯片,但高于分立逻辑电路 数十倍的价格,可能会让你觉得不划算。
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