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发表于 2023-1-27 06:59 | 显示全部楼层
我用电子仿真软件,仿出世界著名的D类功放UCD的控制原理。

1.通过调节补偿网络参数能得到谐振点,仿真结果与理论计算值一致。

2.空输入下输出是单频点500kHz附近,可调。

3.有输入sin信号下谐振是频段式的,因为fsw=fswo(1-M^2)

想再仿purifi(1et400a)控制原理,苦于无电路图。谁有吗?

有的话麻类烦发邮件给我,回报是我仿真文件发给你,谢谢!

49996450@qq.com

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发表于 2023-1-27 16:51 来自手机端 | 显示全部楼层
听感比如lm3886的玩意,指标再好也无意义

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听感比如lm3886的玩意,指标再好也无意义

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听感不如lm3886的玩意,指标再好也无意义

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仿真波形很漂亮,但要仿真出很糟糕也是很容易的

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UCD UM10155仿真简单的

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发表于 2023-1-28 21:01 | 显示全部楼层
mqcing 发表于 2023-1-27 18:10
听感比如lm3886的玩意,指标再好也无意义

这么说你有1et400a咯?

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官方使用的Php18nq11t那有货

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 楼主| 发表于 2023-1-30 05:11 | 显示全部楼层
本帖最后由 akljh 于 2023-1-30 05:13 编辑

我觉得主要核心技术是控制环路设计中的零极点配置问题。
可以看下《开关电源控制环路设计》这本书,Chritophe Basso.这本书主要闭环控制稳定性,而D类功放除了这个还有0度时的自激振荡,原理与控制是相通的
ucd发明人Bruno写的很多论文都不讲这些,只给结果,不讲如何零极点配置,真是的。
NC400和1et400a(purifi)改进我观察主要有
1.指高了系统增益(由于增加了零极点)提高音频的稳定性。
2.零极点配置补偿器由II型转为III型,即1对零点,1对极点,1单极点,+LC滤波器1对极点,比原来的UCD多了1零点和1极点,相角裕度提升更多
3.LC中,C的ESR变小,减小输出阻抗,即提升了阻尼系数,针对大动态音箱。
观点不一定对,欢迎大家一起讨论

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发表于 2023-1-30 06:21 | 显示全部楼层
兄弟你天真了,你以为这是国内权威的音频放大器论坛。
实际上
这是一帮技术基本不懂,就想要有自己小时候想要的那台功放的人搞的论坛,他们甚至连焊锡的熔点多少都不知道。
不会有人跟你讨论技术的,只会从另一角度,风言风语的打击你。
B&W的无线音箱都卖了不知道多少了,他们还在研究音箱线对音质的影响,300B的电丝供电对音质的影响,耦合电容对音质的影响。

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发表于 2023-1-30 07:45 | 显示全部楼层
本论坛水平还是可以的,实际水平可能更高。

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发表于 2023-1-30 07:52 来自手机端 | 显示全部楼层
akljh 发表于 2023-1-30 05:11
我觉得主要核心技术是控制环路设计中的零极点配置问题。
可以看下《开关电源控制环路设计》这本书,Chrito ...

Hypex的实际UCD产品引入了新的零点

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发表于 2023-1-30 17:57 | 显示全部楼层
仿真嘛早就弄过了,验证的pcb也都打过样了,没啥难度的。
这个线路的关键点就是楼上这个模型的ADC,ADC的转换时间决定了你放大器的失真水平。至于怎么实现这个ADC,方法有很多,怎么搭都行,关键是时间!
前几天我试了下用EPC的氮化镓管子跑了下仿真,效果非常好,频率轻轻松松就能跑1.5MHZ以上,仿真的失真和purifi的一个水平,计划打个样试试。
这个线路的原理不复杂,但还是有些小细节的,比如怎么实现输出的过流过压保护,等等。

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 楼主| 发表于 2023-1-30 23:56 | 显示全部楼层
netdemon 发表于 2023-1-30 06:21
兄弟你天真了,你以为这是国内权威的音频放大器论坛。
实际上
这是一帮技术基本不懂,就想要有自己小时候 ...

你要相信高手在民间,只是比较低调而已,我这是抛砖引玉.

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 楼主| 发表于 2023-1-31 00:08 | 显示全部楼层
封箱带 发表于 2023-1-30 17:57
仿真嘛早就弄过了,验证的pcb也都打过样了,没啥难度的。
这个线路的关键点就是楼上这个模型的ADC,ADC的 ...

上图只是个原理模型就是发明人bruno的论文里的,实际电路中那个ADC是用比较器实现的移相自激振荡PWM,振荡频率点的增益要大于0db相角裕度0度同时满足这两条件,振荡频率的设计就是要先搞明白原理,分析环路传递函数的波特图及零极点配置,优化性能,特别互补失真。这些知识存在于《信号与系统》、《自动控制原理》、《开关电源设计》等专业课程中,可以了解下。

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 楼主| 发表于 2023-1-31 00:14 | 显示全部楼层
封箱带 发表于 2023-1-30 17:57
仿真嘛早就弄过了,验证的pcb也都打过样了,没啥难度的。
这个线路的关键点就是楼上这个模型的ADC,ADC的 ...

bruno本人在人在论文里表达认为没必要再提升频率了500k足够了,你1.5M下,比较器自带的100~200ns纯滞后对不同占空比下的pwm频率飘移影响会很大。

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 楼主| 发表于 2023-1-31 00:15 | 显示全部楼层
封箱带 发表于 2023-1-30 17:57
仿真嘛早就弄过了,验证的pcb也都打过样了,没啥难度的。
这个线路的关键点就是楼上这个模型的ADC,ADC的 ...

purifi的1et400a的图有吗?贴出来一起研究下

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发表于 2023-1-31 11:03 来自手机端 | 显示全部楼层
akljh 发表于 2023-1-31 00:14
bruno本人在人在论文里表达认为没必要再提升频率了500k足够了,你1.5M下,比较器自带的100~200ns纯滞后对 ...

你用100ns的比较器是跑不了1M以上的,我设计的整个输出级的延时才不到50ns。
500k的采样频率已经比20khz高了25倍,肯定足够了,但是,这个放大器的能够工作的频率上限决定了它的的失真水平,你可以设计一个跑2M以上的线路,然后降频到500k,这个放大器的性能就非常好了。
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