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 楼主| 发表于 2017-4-18 08:31 | 显示全部楼层
jdog 发表于 2017-4-17 12:10
AUNE 里CPLD作为时钟主设备, M3扮演从设备。 M3根据CPLD的时钟节奏输出数据,CPLD根据数据内特定标志,完 ...

还没试过I2S的从模式,有机会试一下
不过有个问题没想明白,M3是从模式,DAC也是从模式,二者都使用同一个时钟,但是I2S数据在CPLD里是要经过FIFO的,这里有个延迟,这样没有问题吗?

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发表于 2017-4-19 11:39 | 显示全部楼层
c_azrael 发表于 2017-4-18 08:31
还没试过I2S的从模式,有机会试一下
不过有个问题没想明白,M3是从模式,DAC也是从模式,二者都使用同一 ...

CPLD里没有FIFO,AUNE的FIFO在M3里实现了
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发表于 2017-4-19 14:20 | 显示全部楼层
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 楼主| 发表于 2017-4-19 17:31 | 显示全部楼层
jdog 发表于 2017-4-19 11:39
CPLD里没有FIFO,AUNE的FIFO在M3里实现了

就算没有FIFO,也得至少有个锁存吧?那么就是说,U口和M3的I2S是异步的,CPLD到DAC也是异步的?

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发表于 2017-4-19 18:52 | 显示全部楼层
U口和M3的数据是异步的,CPLD到DAC I2S 是同步,CPLD内部输出口通常会reclock一下。说白了,CPLD就是时钟中心,按照这个时钟节奏从PC拖数据过来,然后也按这个时钟节奏主发至后端DAC

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发表于 2017-4-20 13:19 来自手机端 | 显示全部楼层
cpld外接晶振直接影响到输出时针的质量,但cpld的门抖动在什么级别就没有数据了,晶振应达到什么级别才不会成为瓶颈也不好度量了,DIY没有数据的支持,只能是摸石头过河

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 楼主| 发表于 2017-4-21 08:56 | 显示全部楼层
jdog 发表于 2017-4-19 18:52
U口和M3的数据是异步的,CPLD到DAC I2S 是同步,CPLD内部输出口通常会reclock一下。说白了,CPLD就是时钟中 ...

就是说都不用锁存,收到即发?

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 楼主| 发表于 2017-4-21 09:00 | 显示全部楼层
另外DSD数据是不是直通的啊,好像没有经过CPLD呢

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 楼主| 发表于 2017-4-21 20:32 | 显示全部楼层
自顶,看Amanero的原理图,好像DSD输出直接到接口了

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哈哈!没准就实现了几个D触发器,别想多了~

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swing 发表于 2017-6-8 22:17
哈哈!没准就实现了几个D触发器,别想多了~


哈哈,是有可能啊

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自己用CPLD写一个就完事了   EPM240即可完成  还有直接IIS转同轴  同轴还可以支持DOP输出  比淘宝那些所谓的WM8805转出来的效果好的多了

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心只有你8958 发表于 2017-6-29 11:21
自己用CPLD写一个就完事了   EPM240即可完成  还有直接IIS转同轴  同轴还可以支持DOP输出  比淘宝那些所谓 ...


我是一年前用的WM8804直接转,比单端转换独立版的解析背景好一些。EPM240 192个宏单元,仅仅做封包解包和SPDIF拼装应该够用了。下一步我打算玩玩。发射比接收端要简单些,好呆不需要去做SPDIF识别和检波识别采样还要控制系统时钟。
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