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发表于 2017-4-6 11:55 | 显示全部楼层
仅仅是个缓冲器或者reclock么,或者是时钟管理
另外艾特一位高手@xinghuaman

补充内容 (2017-6-10 11:58):
补充个问题,DSD是不是没有经过CPLD呀

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 楼主| 发表于 2017-4-6 21:33 | 显示全部楼层
自顶,而且PCM和DSD的都是怎么处理的呢

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发表于 2017-4-6 22:03 来自手机端 | 显示全部楼层
只是个USB转换成II2界面,效果处理都是在电脑上处理的。

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 楼主| 发表于 2017-4-7 16:07 | 显示全部楼层
heju 发表于 2017-4-6 22:03
只是个USB转换成II2界面,效果处理都是在电脑上处理的。

是atmel的cortex m3是界面,但是xilinx的那个cpld是什么功能

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 楼主| 发表于 2017-4-8 11:07 | 显示全部楼层
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发表于 2017-4-8 14:25 | 显示全部楼层
我不懂。

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发表于 2017-4-8 15:01 | 显示全部楼层
Atmel Cortex M3负责USB数据接收,然后Xilinx CPLD在外部双晶振的协助下负责对不同的信号和采样率进行处理(包括解析DoP),向DAC芯片输出正确的PCM/DSD信号。

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 楼主| 发表于 2017-4-8 21:38 | 显示全部楼层
verite 发表于 2017-4-8 15:01
Atmel Cortex M3负责USB数据接收,然后Xilinx CPLD在外部双晶振的协助下负责对不同的信号和采样率进行处理 ...

你还是没明白我问的,你说的这些我前边的回复都已经说过了
我其实就是想知道CPLD在处理什么,用ARM直接可以输出I2S或者DSD,atsam的优势仅仅是内置hs的phy
XC2C64就只是做时钟管理么?感觉大材小用了吧

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 楼主| 发表于 2017-4-10 19:29 | 显示全部楼层
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发表于 2017-4-10 20:53 | 显示全部楼层
c_azrael 发表于 2017-4-8 21:38
你还是没明白我问的,你说的这些我前边的回复都已经说过了
我其实就是想知道CPLD在处理什么,用ARM直接 ...

才几十个逻辑单元,做不了多少东西

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发表于 2017-4-10 20:53 | 显示全部楼层
verite 发表于 2017-4-8 15:01
Atmel Cortex M3负责USB数据接收,然后Xilinx CPLD在外部双晶振的协助下负责对不同的信号和采样率进行处理 ...

解DOP是MCU做的,CPLD这么少资源没法做

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发表于 2017-4-11 07:58 | 显示全部楼层
M3负责USB传递过来的音频数据协议转换,当然包括所谓的DOP数据,这些你可以查看UAC2.0协议。CPLD只是负责时钟系统管理和向M3提供音频时钟及重建IIS部分信号,确保M3转换生成的IIS在同一的时钟系统下达到更好的同步性和数据的完整性。而且CPLD确实可以有效的降低信号的抖动和相位偏差。

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任何原理和实现方式,都有优缺点,万事万物都不可能十全十美。
audiobyte 其实也对amanero的一些弱点做了改进,但代价是惨痛的。

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amanero的高明之处,在用最小的投入获取更大的回报。

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lter15 发表于 2017-4-10 20:53
才几十个逻辑单元,做不了多少东西


XC2C64不少了,如果只做时钟管理普通逻辑器件就做了,都不需要CPLD

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为了加密,保护自有知识产权,对电路本身有害无益

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 楼主| 发表于 2017-4-12 12:59 | 显示全部楼层
xinghuaman 发表于 2017-4-11 07:58
M3负责USB传递过来的音频数据协议转换,当然包括所谓的DOP数据,这些你可以查看UAC2.0协议。CPLD只是负责时 ...

高手出现了,膜拜一下
时钟管理的功能是不是就类似于那些可编程时钟芯片了,给M3的被动I2S?
重建I2S信号是和论坛的AUNE介绍里CPLD主要功能是做FIFO一样吧?
类似于audiobyte之类的方案是不是用FPGA了,FPGA时序分析本身就是一个相当需要研究的问题,感觉用来做时钟方面的功能还是CPLD更合适

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c_azrael 发表于 2017-4-12 12:59
高手出现了,膜拜一下
时钟管理的功能是不是就类似于那些可编程时钟芯片了,给M3的被动I2S?
重建I2S信 ...

说的已经够多。其他自己领悟吧

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 楼主| 发表于 2017-4-15 23:57 | 显示全部楼层
xinghuaman 发表于 2017-4-15 12:14
说的已经够多。其他自己领悟吧

明白,感谢高手
看来这CPLD功能确实比我所想象的要简单的多得多,但是做好的确不易
再次感谢

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发表于 2017-4-17 12:10 | 显示全部楼层
AUNE 里CPLD作为时钟主设备, M3扮演从设备。 M3根据CPLD的时钟节奏输出数据,CPLD根据数据内特定标志,完成PCM I2S码流或者DSD 源码码流输出。
这样码流输出质量理论只和CPLD外两颗晶振品质,及CPLD门抖动有关。
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