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发表于 2015-8-18 08:57 | 显示全部楼层
也并不是什么不可复制的技术,不可复制的是"dcs"
dcs也有很庞大的R2R阵列,应该就是3、5年前的产品吧

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看了好久都觉得dcs的5bit跟流传的所谓Analog FIR是大同小异的,HQP作者Jussi称之为温度计式,只不过dcs把Multi-level换成权电阻。。。 LZ可否就dcs再多说点?

Analog FIR.png

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发表于 2015-8-18 23:26 | 显示全部楼层
forsli@163.com 发表于 2015-8-18 08:57
也并不是什么不可复制的技术,不可复制的是"dcs"
dcs也有很庞大的R2R阵列,应该就是3、5年前的产品吧

关键还有算法复制不了
硬件电路就很简单,掉给深圳的厂家,完整抄出来。

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lter15 发表于 2015-8-18 23:26
关键还有算法复制不了
硬件电路就很简单,掉给深圳的厂家,完整抄出来。

ASRC、DF算法难复制

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发表于 2015-8-19 09:23 | 显示全部楼层
啊哦,纯粹的硬件复刻R2R的电阻DAC基本没有成功的可能性。电阻离散大,没有特殊的算法把R2R的失真消除,即使复刻了,声音也是很糟糕的。MSB金条也是R2R电阻网络,通过软件算法,把失真搞到高频,然后用LPF滤除。我其实很想知道这个算法。。。

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发表于 2015-8-19 09:32 | 显示全部楼层
iflyingpig 发表于 2015-8-19 09:23
啊哦,纯粹的硬件复刻R2R的电阻DAC基本没有成功的可能性。电阻离散大,没有特殊的算法把R2R的失真消除,即 ...

其实我觉得,他们还会针对每一台机器进行校准,然后把校准数据写进每台机器里面。
高端机器,本来产量就不高,一年也卖不了多少台。每一台进行校准,也花不了多少时间。

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iflyingpig 发表于 2015-8-19 09:23
啊哦,纯粹的硬件复刻R2R的电阻DAC基本没有成功的可能性。电阻离散大,没有特殊的算法把R2R的失真消除,即 ...

把失真搞到高频?这说法的出处?指点条路子咱去看看

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forsli@163.com 发表于 2015-8-19 12:01
把失真搞到高频?这说法的出处?指点条路子咱去看看

就是教科书上的noise-shaping dac啦。。。

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forsli@163.com 发表于 2015-8-19 12:01
把失真搞到高频?这说法的出处?指点条路子咱去看看

我也不知道是哪个具体的技术,有一次听朋友说的,他和MSB工程师聊过。

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Emphasis 发表于 2015-8-19 14:15
就是教科书上的noise-shaping dac啦。。。

噪声整形技术?噪声转移=失真转移?

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forsli@163.com 发表于 2015-8-19 15:05
噪声整形技术?噪声转移=失真转移?

msb的分立R2R基本是一个noise-shaping dac,仅此而已

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Emphasis 发表于 2015-8-19 15:15
msb的分立R2R基本是一个noise-shaping dac,仅此而已

MSB的不清楚,dcs的5BIT算法基本是PCM转1BIT、再多位元量化成PCM。

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搬板凳仔细听课,期待解读DSC的电路。

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 楼主| 发表于 2015-9-2 05:26 | 显示全部楼层
最近在忙论文特别烦 所以抱歉很久才更新

20091104134508.gif

如果我说所谓的5bit技术就是如图所示的更为屌丝的技术的话 有人会信么

但是我还并不是完全确信原因是: 手边暂时还没有足够多的逻辑分析仪可以测如此庞大的电阻网络.
但是经过我16bit的逻辑分析仪测过 可以肯定他的结构并不是有些人所言多片1bit并联 而是一套复杂的解码方案。
经检验,至少每颗ACT175的输入管脚是完全不一样的,而且有这么多颗电阻完全可以堆得出来所谓的5bit也就是32位电压调制

再结合dcs的技术文档和他们家的机型拆机就可以发现其实ringdac对ACT175这类的开关数目不敏感 因此也可以推理得出ringdac确实有可能只用到其中的32颗电阻而已。
我大概猜了下dcs的DA转换原理 大概就是5bit电子电位器的高频玩法。

假设说我们现在有一个并行输入的5bit电子电位器,他们每个fs周期只能在0-31这32个档位之间不停切换
那么 假如我们提高fs到2xfs 再过一次滤波器 波形就会变得缓和起来跟原波形更为接近
以此类推 如果我们能实现一个64fs=2.8224Mhz的升频 并且试输出波形进入一个设计得当的低通滤波网络的话,那么波形也将会变得平滑更加接近于原波形。

这么做有几个原因
第一就是运算量不大毕竟只有5bit怎么加减乘除都不可能跟24bit那样变态, 况且24bit的波形也不能往死里升到64倍 128倍 因为如此一来SCLK的频率都要暴表了 对于一般的解码芯片是肯定没戏了 但是对于全分立R2R结构是处于正好的频率,因此可以期待他的优秀表现。
第二个优势就是sclk和fsclk的频率都不会太高 对于走线的要求不苛刻可以随便走没压力
第三个就是glitch的频率被移高了 更加容易被滤走 波形更加完美

以上是我的猜想,等我把相应的仪器安顿好就好好测试一下~上波形图

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 楼主| 发表于 2015-9-2 05:28 | 显示全部楼层
虽然不太确定,但是可以肯定的是dcs的解码方案是用高速低分辨率获得高精度 也就是说跟将来的低比特DAC芯片的原理是基本相似的

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 楼主| 发表于 2015-9-2 05:30 | 显示全部楼层
lter15 发表于 2015-8-19 09:32
其实我觉得,他们还会针对每一台机器进行校准,然后把校准数据写进每台机器里面。
高端机器,本来产量就 ...

不能指望老外那点工作效率呀
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